PCI总线总线信号PCI总线信号定义示意图PCI总线标准所定义的信号线通常分成必需的和可选的两大类
其信号线总数为120条（包括电源、地、保留引脚等）
其中，必需信号线：主控设备49条，目标设备47条
可选信号线：51条（主要用于64位扩展、中断请求、高速缓存支持等）
主设备是指取得了总线控制权的设备，而被主设备选中以进行数据交换的设备称为从设备或目标设备
作为主设备需要49条信号线，若作为目标设备，则需要47条信号线，可选的信号线有51条
利用这些信号线便可以传输数据、地址，实现接口控制、仲裁及系统的功能
PCI局部总线信号如下所示
下面按功能分组进行说明：1）系统信号CLK IN：系统时钟信号，为所有PCI传输提供时序，对于所有的PCI设备都是输入信号
其频率最高可达33MHz/66MHz，这一频率也称为PCI的工作频率
RST# IN：复位信号
用来迫使所有PCI专用的寄存器、定序器和信号转为初始状态
2）.地址和数据信号 AD[31：：00]T/S：地址、数据复用的信号
PCI总线上地址和数据的传输，必需在FRAME#有效期间进行
当FRAME#有效时的第1个时钟，AD[31：：00]上的信号为地址信号，称地址期；当IRDY#和TRDY#同时有效时，AD[31：：00]上的信号为数据信号，称数据期
一个PCI总线传输周期包含一个地址期和接着的一个或多个数据期
C/BE[3：：0]# T/S：总线命令和字节允许复用信号
在地址期，这4条线上传输的时总线命令；在数据期，它们传输的时字节允许信号，用来指定在数据期，AD[31：：00]线上4个数据字节中哪些字节为有效数据，以进行传输
PAR T/S：奇偶校验信号
它通过AD[31：：00]和C/BE[3：：0]进行奇偶校验
主设备为地址周期和写数据周期驱动PAR，从设备为读数据周期驱动PAR
3）.接口控制信号 FRAME# S/T/S：帧周期信号，由主设备驱动
表示一次总线传输的开始和持续时间
当FRAME#有效时，预示总线传输的开始；在其有效期间，先传地址，后传数据；当FRAME#撤消时，预示总线传输结束，并在IRDY#有效时进行最后一个数据期的数据传送
IRDY# S/T/S：主设备准备好信号
IRDY#要与TRDY#联合使用，当二者同时有效时，数据方能传输，否则，即为未准备好二进入等待周期
在写周期，该信号有效时，表示数据已由主设备提交到AD[31：：00]线上；在读周期，该信号有效时，表示主设备已做好接收数据的准备
TRDY# S/T/S：从设备（被选中的设备）准备好信号
同样TRDY#要与IRDY#联合使用，只有二者同时有效，数据才能传输
STOP# S/T/S：从设备要求主设备停止当前的数据传送的信号
显然，该信号应由从设备发出
LOCK# S/T/S：锁定信号
当对一个设备进行可能需要多个总线传输周期才能完成的操作时，使用锁定信号LOCK#，进行独占性访问
例如，某一设备带有自己的存储器，那么它必需能进行锁定，以便实现对该存储器的完全独占性访问
也就是说，对此设备的操作是排它性的
IDSEL IN：初始化设备选择信号
在参数配置读/写传输期间，用作片选信号
DEVSEL# S/T/S：设备选择信号
该信号由从设备在识别处地址时发出，当它有效时，说明总线上有某处的某一设备已被选中，并作为当前访问的从设备
4）.仲裁信号（只用于总线主控器） REQ# T/S：总线占用请求信号
该信号有效表明驱动它的设备要求使用总线
它是一个点到点的信号线，任何主设备都有它自己的REQ#信号
GNT# T/S：总线占用允许信号
该信号有效，表示申请占用总线的设备的请求已获得比准
5）.错误报告信号 PERR# S/T/S：数据奇偶校验错误报告信号
一个设备只有在响应设备选择信号（DEVSEL#）和完成数据期之后，才能报告一个PERR#
SERR# O/D：系统错误报告信号
用做报告地址奇偶错、特殊命令序列中的数据奇偶错，以及其他可能引起灾难性后果的系统错误
它可由任何设备发出
6）.中断信号 在PCI总线中，中断是可选项，不一定必须具有
INTA# O/D：用于请求中断
INTB# O/D、INTC# O/D、INTD# O/D：用于请求中断，仅对多功能设备有意义
所谓的多功能设备是指：将几个相互独立的功能集中在一个设备中
各功能与中断线之间的连接是任意的，没有任何附加限制
7.）其他可选信号 （1）高速缓存支持信号：SBO# IN/OUT、SDONE IN/OUT （2）64位总线扩展信号：REQ64# S/T/S、ACK65# S/T/S、AD[63：：32]T/S、C/BE[7：：4]#T/S、PAR64 T/S
（3）测试访问端口/边界扫描信号：TCK IN、TDI IN、TDO OUT、TMS IN、TRST# IN
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